Файловый менеджер - Редактировать - /usr/src/linux-headers-5.4.0-200/arch/sh/include/mach-common/mach/highlander.h
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/* SPDX-License-Identifier: GPL-2.0 */ #ifndef __ASM_SH_RENESAS_R7780RP_H #define __ASM_SH_RENESAS_R7780RP_H /* Box specific addresses. */ #define PA_NORFLASH_ADDR 0x00000000 #define PA_NORFLASH_SIZE 0x04000000 #if defined(CONFIG_SH_R7780MP) #define PA_BCR 0xa4000000 /* FPGA */ #define PA_SDPOW (-1) #define PA_IRLMSK (PA_BCR+0x0000) /* Interrupt Mask control */ #define PA_IRLMON (PA_BCR+0x0002) /* Interrupt Status control */ #define PA_IRLPRI1 (PA_BCR+0x0004) /* Interrupt Priorty 1 */ #define PA_IRLPRI2 (PA_BCR+0x0006) /* Interrupt Priorty 2 */ #define PA_IRLPRI3 (PA_BCR+0x0008) /* Interrupt Priorty 3 */ #define PA_IRLPRI4 (PA_BCR+0x000a) /* Interrupt Priorty 4 */ #define PA_RSTCTL (PA_BCR+0x000c) /* Reset Control */ #define PA_PCIBD (PA_BCR+0x000e) /* PCI Board detect control */ #define PA_PCICD (PA_BCR+0x0010) /* PCI Conector detect control */ #define PA_EXTGIO (PA_BCR+0x0016) /* Extension GPIO Control */ #define PA_IVDRMON (PA_BCR+0x0018) /* iVDR Moniter control */ #define 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(PA_BCR+0x0404) /* SCIF0 Bit rate control */ #define PA_SCSCR0 (PA_BCR+0x0408) /* SCIF0 Serial control */ #define PA_SCFTDR0 (PA_BCR+0x040c) /* SCIF0 Send FIFO control */ #define PA_SCFSR0 (PA_BCR+0x0410) /* SCIF0 Serial status control */ #define PA_SCFRDR0 (PA_BCR+0x0414) /* SCIF0 Receive FIFO control */ #define PA_SCFCR0 (PA_BCR+0x0418) /* SCIF0 FIFO control */ #define PA_SCTFDR0 (PA_BCR+0x041c) /* SCIF0 Send FIFO data control */ #define PA_SCRFDR0 (PA_BCR+0x0420) /* SCIF0 Receive FIFO data control */ #define PA_SCSPTR0 (PA_BCR+0x0424) /* SCIF0 Serial Port control */ #define PA_SCLSR0 (PA_BCR+0x0428) /* SCIF0 Line Status control */ #define PA_SCRER0 (PA_BCR+0x042c) /* SCIF0 Serial Error control */ #define PA_SCSMR1 (PA_BCR+0x0500) /* SCIF1 Serial mode control */ #define PA_SCBRR1 (PA_BCR+0x0504) /* SCIF1 Bit rate control */ #define PA_SCSCR1 (PA_BCR+0x0508) /* SCIF1 Serial control */ #define PA_SCFTDR1 (PA_BCR+0x050c) /* SCIF1 Send FIFO control */ #define PA_SCFSR1 (PA_BCR+0x0510) /* SCIF1 Serial status control */ #define PA_SCFRDR1 (PA_BCR+0x0514) /* SCIF1 Receive FIFO control */ #define PA_SCFCR1 (PA_BCR+0x0518) /* SCIF1 FIFO control */ #define PA_SCTFDR1 (PA_BCR+0x051c) /* SCIF1 Send FIFO data control */ #define PA_SCRFDR1 (PA_BCR+0x0520) /* SCIF1 Receive FIFO data control */ #define PA_SCSPTR1 (PA_BCR+0x0524) /* SCIF1 Serial Port control */ #define PA_SCLSR1 (PA_BCR+0x0528) /* SCIF1 Line Status control */ #define PA_SCRER1 (PA_BCR+0x052c) /* SCIF1 Serial Error control */ #define PA_SMCR (PA_BCR+0x0600) /* 2-wire Serial control */ #define PA_SMSMADR (PA_BCR+0x0602) /* 2-wire Serial Slave control */ #define PA_SMMR (PA_BCR+0x0604) /* 2-wire Serial Mode control */ #define PA_SMSADR1 (PA_BCR+0x0606) /* 2-wire Serial Address1 control */ #define PA_SMTRDR1 (PA_BCR+0x0646) /* 2-wire Serial Data1 control */ #define PA_VERREG (PA_BCR+0x0700) /* FPGA Version Register */ #define PA_POFF (PA_BCR+0x0800) /* System Power Off control */ #define PA_PMR (PA_BCR+0x0900) /* */ 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